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1、引言在实际的通信系统中，为了扩大通信链路的容量，提高通信系统的利用率，需要在一条链路上传输多路独立的信号，即实现多路通信。时分复用就是一种常用的多路通信方式。它采用同一物理连接的不同时段来传输不同的信号以达到多路传输的目的。多路时分复用以时间作为信号分割的参量，故必须使各路信号在时间轴上互不重叠。时分多路复用适用于数字信号的传输。由于信道的位传输率超过每一路信号的数据传输率，因此可将信道按时间分成假如干片段轮换地给多个信号使用。每一时间片由复用的一个信号单独占用,在规定的时间内,多个数字信号都可按要求传输到达,从而也实现了一条物理信道上传输多个数字信号。本实验系统的预期功能是通过设计的仿真系统
2、运行能够得出各路的信号波形、复用后的信号波形以与解复用的各点波形。主要原理图示如下：图1-1 复接、解复接流程图图1-2 按字复接示意图帧同步码8位8位8位8位8位8位8位01110010数据1数据2数据3数据4数据5数据6数据7图1-3 时分复用输出信号帧结构图1-4 特征信号复接波形示意图1、 系统框图与分析本次仿真实现不同速率信号的时分多路复用系统。共八路输入信号，其中第一路信号为帧同步码信号，其余各路为用户信息信号。设标准频率均为1/8000，即每比特125s标准位，8个比特作为一个周期序列，即1个标准帧帧长为1ms。时分多路系统仿真模型图框架如如下图所示： 图2-1 时分多路复用系统
3、仿真模型图系统主要分为五大模块：1特征信号产生模块subsystem2并串转换模块repositor3信号提取模块filter4特征信号别离模块demultiplexer5信号复原模块transmission其中12模块又可看成复用局部，345可看成解复用局部。2、 各局部结构原理与分析1、 特征信号产生模块特征信号产生器框图如下所示。 图3-1 时分多路系统仿真模型图内部构成：一级定时时钟频率1/8000，延时模块，特征信号产生器上图中的Subsystem5等。各路输入信号序列依次为0 1 1 1 0 0 1 00 1 0 1 0 1 1 11 1 0 1 1 0 0 0 0 1 0 1 1
4、 0 1 01 0 0 1 1 1 0 10 0 1 1 0 1 1 10 0 1 1 0 1 0 1 0 1 1 1 0 1 1 0。其中，第一路为帧同步码，采用巴克码。第三路频率为1/4000，第四路频率为1/2000，第五路频率为1/4000，其余各路为标准频率1/8000。图3-2 各路输入信号波形每路输入信号的每个延时单元频率与该路信号原频率一样。使第18路输入信号分别延时18个单元，利于时钟抽样。定时时钟的每个延时单元频率均为1/(2*8000)，可使时钟延迟一个上升沿进展采样。之所以是1/(2*8000)而不是1/8000，是由于占空比50%的原因级联延时单元，使每路信号的Sub
5、system5-8的时钟起始时间产生相应延时，便于经过Subsystem5-12处理后的各路信号合拼到同一信号。即使各路输入信号经过Subsystem5-12压缩字长信息到一位，再依次延时一至八位，以便并串转换器依次抽取各路压缩特征信号，合并到复用帧的第一至八位延时信号波形上表现为原波形右移相应延时时间。第一至八路定时时钟分别延迟了18个标准位。Scope示波器输出延时后的各输入信号和经由Subsystem5、6、7、8处理后的各中间信号。延时后的各输入信号波形上表现为右移14个比特。（1） Subsystem5-12功能分析内部构成如如下图。其中二级时钟频率1/8000*8，作为Multip
6、ort Switch的抽样频率，共8路分解信号合成一个特征信号，因复用帧帧长为原信号的字长，故二级时钟频率设置为1/8000*8。Subsystem以8比特为周期一个字周期，也是一帧周期，每一比特作为单位，依次将该路信号分解成8路，其中，原信号每个上升沿时刻分解出的信号在该时刻起置1。分解出的8路信号送往Multiport Switch进展抽样。Multiport Switch经过抽样合并形成一路信号输出。这样便形成了特征信号，使复用帧中相应的第N位包含第N路原信号的字信息。此Subsystem5-8模块用于实现“按字复接，使每比特长度由标准位125s变成新的位长。图34 Subsystem5
7、-8的内部构成其中，Counter参数如如下图所示。Counter1-7 的参数 Max count = 7，代表一个周期抽样阶级从0抽到7级，Initial count = 1，代表起始抽样阶级为1，Hit values 依次为 0-7，目的是使时钟信号的第1-8个上升沿分别依次对输入信号的8个比特进展抽样。Hit values = 2，代表当且仅当该周期抽样阶级信号为第2级时如第一个上升沿到达至第二个上升沿到达的期间输出1。其中Subsystem内部结构如下。图3-5 Subsystem内部结构 图3-6 Subsystem中的Counter参数设置Counter2 这一路的时钟、Hit信
8、号Hit values = 2、输出信号的比照如下。由于 Initial count = 1，故 Hit values = 2 对应第2阶级，如图输出1如下图第二路。图3-7 Counter2这一路的时钟、Hit信号Hit values = 2、输出信号的比照Subsystem5中的Scope1输出波形如下即经由Subsystem处理后的信号波形如上所述，Subsystem的时钟为一级时钟经过延迟单元后的时钟，Subsystem将该路信号分解出8路信号，每个上升沿时刻置1，送往Multiport Switch进展抽样，合并形成一路信号输出。图3-8 Subsystem5的内部信号分析比照图上图
9、中的阶梯信号由Subsystem5二级时钟经过Counter1后产生，作为MultiportSwitch的选通信号，当级数为N时选通Out(N+1)，对Subsystem的输出信号进展抽样。抽样结果如上图最后一行所示。从起才得到合要求的抽样，这是因为Subsystem在之后才完成对原信号的8路分解。Subsystem5-8的特征信号输出如如下图偶数行所示。Subsystem9-12与Subsystem5-8类似，因此不再分析。图3-9 Subsystem5-8的特征信号输出（2） 特征信号产生模块的输出波形各路特征信号输出波形为如下图第1-8行，按字复接后的信号为第9行。由于Multiport
10、 Switch的关系，按字复接后的信号在3ms后才能保证完整表现复接信号的特征。其中，第一路传输帧同步码，采用巴克码。第三路频率为1/4000，第四路频率为1/2000，第五路频率为1/4000，其余各路为标准频率1/8000。图3-10 各路特征信号与复用帧信号输出波形由图可见，两组红线之间的局部为第三路信号在复接信号中的位置，其出现一个完整周期的时间为2ms，读图，该信号为01101100 00011110，由于第三路信号的频率为标准频率1/8000的一半，因此标准频率信号在复接信号中出现一个完整周期所需时间为1ms，而第三路信号如此要2ms，相应地，每两个0为原信号的一个0，每两个1为原
11、信号的一个1，因此0,11,11,00,0 0,00,11,11,0 从倒数第二组1起循环右数，即为第三路原信号11011000。由于第四路信号频率为1/2000，故复接信号的波形周期为4ms，比如3-7ms 和 7-11ms，各为一个周期时间，即复用帧帧长以最低频率的输入信号为基准，这里为4ms。2、 并串转换模块时钟频率为1/8000。此模块对前面产生的各路特征信号进展依次抽取，合并到复用帧的第一至八位，产生复用帧信号，波形见图3-10。图3-11 并串转换模块内部结构3、 信号提取模块内部主要组件为帧同步模块、延时模块和多路选通模块。图3-12 信号提取模块内部结构（1） 帧同步模块通过
12、延时和逻辑运算来识别帧同步码巴克码01110010，从而提取帧同步脉冲。图3-13 帧同步模块内部结构信号提取模块中的Scope波形如下，其中第一行波形为复用帧同步脉冲，第二至四行为经过延时和逻辑运算的中间过程，第五行为字同步信号，字长为原输入信号的位长，第六行为复用帧信号，第七行为去除帧同步码后的复用帧信号以下简称复用帧信号。图3-14 信号提取模块的Scope波形信号提取模块中的Scope1波形如下，其中第一行波形为复用帧同步脉冲，第二至四行为经过延时和逻辑运算的中间过程，第五行为时分解复用模块的定时时钟信号。图3-15 信号提取模块的Scope1波形4、 特征信号别离模块特征信号别离模块
13、内部结构如下，对信号提取模块产生的字同步信号分别做相应的延时，再与复用帧信号相与，别离出7路特征信号。图3-16 特征信号别离模块内部结构图别离出的7路特征信号波形如下2至8行，即最顶层Scope2所示。图3-17 特征信号别离模块波形输出5、 信号复原模块信号复原模块的内部结构如下。其中filter用于对clk即信号提取模块中产生的帧同步脉冲进展处理，产生pulse信号输入到Subsystem9-12作为特征信号抽样脉冲。信号提取模块中产生的SwitchCLK作为Subsystem9-12的定时时钟信号。图3-18 特征信号别离模块内部结构图图3-19 特征信号别离模块输出波形 下面以Sub
14、system9为例进展分析。Subsystem9主要由Subsystem1和Multiport Switch组成。其中Subsystem1用于将特征信号的上升下降状态即0、1状态提取出来8路信号，供Multiport Switch进展多路选通复原原始信号。Subsystem1的原理与内部组成与时分复用模块中的特征信号产生模块相似。图中SwitchCLK为定时时钟信号，频率为标准频率1/8000，由信号提取模块产生提取。此定时时钟信号频率与时分复用模块中的一级定时时钟频率一样，进展相应的延时，作为Multiport Switch的选通时钟，对特征信号的0、1状态进展抽取，复原原输入信号。图3-2
15、0 Subsystem9内部结构图3、 实验数据结果与分析最后各路输出结果与原输入信号的比照如如下图所示，左边为最顶层scope4原输入信号，右边为最顶层scope3TDM解复用后的输出信号，可以看见，除了各路之间的相位关系不一样mmms后才能完全表现出其特征。图4-1 各路输出结果与原输入信号的比照4、 实验分工 找相关文字资料，撰写设计报告，完善修改设计报告内容，设计与调试仿真系统，主要负责特征信号别离模块和信号复原模块。 找相关论文学习资料，撰写实验报告原理与结果分析局部，设计系统框架与原理，主要负责特征信号产生模块和并串转换模块。 找相关视频学习资料，撰写实验报告系统分析与调试局部，设
16、计仿真系统，负责信号提取模块。5、 实验中遇到的问题与解决方法1、不知如何参加帧同步信号，确定信号的起始端。 解决方法：在输入端参加一路信号作为帧同步信号，在解复端利用与门等逻辑运算对帧同步信号进展校验。1、不同速率时帧同步识别出现错误。 解决方法：使用巴克码作为帧同步码，能够准确地提取帧同步信号。3、一开始在解复接局部中采用了外部时钟，后来发现者并不符合要求。 解决方法：在帧同步识别之后，进展相关逻辑运算，提取定时信号作为解复用局部的时钟。6、 参考文献1 吴玲达，李国辉，杨冰 等著. 计算机通信原理与技术M. 国防科技大学，2003.2 潘新民 著. 计算机通信技术M. 电子工业，2003，7.3 孙丽华 著. 信息论与纠错编码M. 电子工业，2005，34 Proakis 著，X力军 译. 数字通信第四版M. 电子工业，2004，7.5 樊昌信 著.通信原理M.国防工业，1999，10.6 钱恭斌.实用通信与电子线路的计算机仿真.：电子工业，2001.1、
