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1、第五单元 触发器和时序逻辑电路,本单元重点知识点,重点掌握触发器的逻辑符号、真值表、状态转换图、特征方程和逻辑波形图。,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,第一节 触发器 触发器是一种能记忆一位二进制数的存储单元。由它可以构造计数器、寄存器、移位寄存器等时序逻辑电路。在一定的外界信号作用时，触发器可以从一个稳态翻转到另一个稳态，当外界信号消失后，能保持更新后的状态。两个稳定的工作状态，一个是“0”态，即输出Q0、。另一个是“1”态，即输出Q1、。当无外界信号作用时，触发器状态维持不变。,第五单元 触发器和时序逻辑电路,触发器分类按功能分类分为：RS、JK、T、D触发
2、器 学习时重点掌握触发器的逻辑符号、真值表、状态转换图、特征方程和逻辑波形图。,第五单元 触发器和时序逻辑电路,一、基本RS触发器 基本RS触发器是构成各种触发器的基本单元。逻辑符号,逻辑图 逻辑符号,有两个输出端：Q、Q；Q的状态为触发器的状态；所以触发器有0态和1态。两个输入端：R、S。R为置1端或置位端，R为置0端或复位端；,第五单元 触发器和时序逻辑电路,1、基本RS触发器真值表 Qn 为现态，Qn+1为次态,第五单元 触发器和时序逻辑电路,2、状态转换图及特征方程：,约束方程（条件）：,特征方程：,第五单元 触发器和时序逻辑电路,二、同步RS触发器,第五单元 触发器和时序逻辑电路,1
3、、同步RS触发器真值表,第五单元 触发器和时序逻辑电路,1、同步RS触发器真值表,约束方程（条件）：,特征方程：,第五单元 触发器和时序逻辑电路,2、D 触发器,由于RS触发器存在约束条件的缺点，可以通过硬件的办法保证RS输入始终相反（与教材略有不同）。利用D触发器，在CP=1作用下将D端的数据送入触发器，因此D触发器又称D锁存器。,第五单元 触发器和时序逻辑电路,2、D 触发器,集成D触发器符号,Qn+1=D（CP=1时）,D 触发器的特征方程：,D触发器的真值表,第五单元 触发器和时序逻辑电路,D触发器的状态图与波形图,第五单元 触发器和时序逻辑电路,3、T 触发器与T触发器,第五单元 触
4、发器和时序逻辑电路,3、T 触发器,电路组成如图510所示，T与CP等效。是由RS触发器加反馈线得来的称为T触发器。类似的有由D触发器加反馈线得来的称为T触发器。功能描述：当T等于1，来一个CP翻转一次。,第五单元 触发器和时序逻辑电路,3、T 触发器,电路组成如图510所示，T与CP等效。是由RS触发器加反馈线得来的称为T触发器。类似的有由D触发器加反馈线得来的称为T触发器。功能描述：当T等于1，来一个CP翻转一次。,第五单元 触发器和时序逻辑电路,3、T 触发器,集成D触发器符号,T触发器的真值表,脉冲下降沿起作用,第五单元 触发器和时序逻辑电路,T触发器的波形图,注意：下降沿触发。如果不
5、是边沿触发，将无法讨论。,第五单元 触发器和时序逻辑电路,1、JK触发器,第五单元 触发器和时序逻辑电路,JK触发器构成,JK触发器也是一种双输入端触发器，将图510T触发器的T端断开，分别作为J，K输入端即可构成JK触发器。,第五单元 触发器和时序逻辑电路,1、JK触发器,JK触发器的真值表,第五单元 触发器和时序逻辑电路,JK触发器的功能描述00保持，11翻转，一高一低随J,第五单元 触发器和时序逻辑电路,JK触发器的波形图,第五单元 触发器和时序逻辑电路,六、基本触发器的空翻和振荡以上介绍的四种触发器都是电位触发方式，即只要在CP脉冲存续期间，触发器就能接收信号，这就带来了基本触发器的缺
6、陷-空翻和震荡。,第五单元 触发器和时序逻辑电路,空翻电位式触发器在CP电平有效期间，能接收控制输入信号。在高电平时，如果输入信号发生多次变化（RS、D)，触发器也会发生相应的多次翻转，这种在一个脉冲期间触发器的状态发生多于一次变化的现象，称为触发器的空翻。空翻意味着失控，即触发器的输出不能严格按时钟节拍工作，没有实用性。,第五单元 触发器和时序逻辑电路,振荡：对于T触发器或JK触发器J=K=1时，应该来一个脉冲翻转一次，如果脉冲宽度过宽，会导致多次翻转，形成振荡。基本触发器并无实用价值。,第五单元 触发器和时序逻辑电路,七、集成触发器 为了实用，必须解决“空翻”与“振荡”问题。常采用的电路为
7、：维持阻塞触发器、边沿触发器、主从触发器等三种触发器。,第五单元 触发器和时序逻辑电路,1维持阻塞触发器 维持阻塞触发器是利用电路内部的维持阻塞线产生的维持阻塞作用来克服空翻的。,第五单元 触发器和时序逻辑电路,2边沿触发器 边沿触发器是利用电路内部门电路的速度差来克服“空翻”的。一般边沿触发器多采用CP脉冲的下降沿触发，也有少数采用上升沿触发方式。,第五单元 触发器和时序逻辑电路,3主从触发器 主从触发器具有主从结构，以此克服空翻。主从触发器是双拍式工作方式，即将一个时钟脉冲分为两个阶段。(1)CP高电平期间，主触发器接收输入控制信号。而从触发器被封锁，保持原状态不变。(2)在CP由10时(
8、即下降沿)主触发器被封锁，保持CP高电平所接收的状态不变，而从触发器解除封锁，接受主触发器的状态输出。,第五单元 触发器和时序逻辑电路,第二节 寄存器 用于将一组二值代码暂时存储起来的逻辑电路称为寄存器。一个触发器只能寄存1位二进制数。,第五单元 触发器和时序逻辑电路,寄存器存放数码的方式和从寄存器取出数码的方式都有并行方式和串行方式两种。输入、输出都为并行方式的寄存器一般称为数码寄存器。其他三种输入、输出形式的寄存器，即串行输入并行输出、并行输入串行输出和串行输入串行输出的寄存器，统称为移位寄存器。,第五单元 触发器和时序逻辑电路,一、数码寄存器 数码寄存器只有存、取数码和清除原有数码的功能
9、。,一、数码寄存器,CP控制端，上升沿作用,一、数码寄存器,二、移位寄存器,移位寄存器 不仅能存放数码而且有移位的功能。移位寄存器不仅能存放数码，而且还具有运算功能。比如，数码左移一位，相当于乘以2；,二、移位寄存器,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,第三节 计数器,计数器可主要用于数字运算、控制、测量及分频和产生节拍脉冲等。计数器种类繁多，就数制而言，有二进制、十进制和任意进制计数器；就计数功能(计数方向)而言，有加法、减法和可逆计数器；而就进位方式而言，又有串行(异步)、并行(同步)和串并行计数器。,一、同步计数器,输入计数脉冲同时作用到各位触发器的CP端，各
10、位触发器同时翻转并产生进位信号，由于不存在各级延迟时间的积累问题，故其工作速度快。,1同步二进制计数器,第五单元 触发器和时序逻辑电路,在构成同步（或者异步）二进制计数器时，不管采用什么逻辑功能的触发器，都应先接成T或T触发器。（D触发器将 倒送回本级D输入端、JK触发器接成J=K，作为T）。,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,三、时序逻辑电路的分析方法1.N进制计数器 由n位触发器可以构成N2n的任意进制计数器。成功的关键K可以接1，J用来清零，CP用来控制翻不翻。（见仿真）,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,第五单元 触发器和时序逻辑电路,
