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CML信号原理CML即Current Mode Logic，也就是电流模式逻辑，CML电路主要靠电流驱动，可以说CML是所有高速数据接口形式中最简单的一种，它的输入与输出是匹配好的，从而减少了外围器件，使用时直接连接就可以，基本上不需要在IC外面做匹配，此特点使单板硬件设计更简单，单板看起来更简洁，CML的摆幅较小，功耗比较低。 CML输出结构： 如上图所示，CML的输出电路形式是一个差分对，该差分对的集电极电阻为50ohm，输出信号的高低电平切换是靠共发射极差分对的开关控制的，差分对的发射极到地的恒流源典型值为16mA，假定CML的输出负载为一50ohm上拉电阻，则单端CML输出信号的摆幅为VCC VCC-0.4V。在这种情况下，差分输出信号摆幅为800mV，共模电压为VCC-0.2V。若CML输出采用交流耦合至50ohm负载，这时的直流阻抗由集电极电阻决定，为50ohm，CML输出工模电压变为VCC-0.4V，差分信号摆幅仍为800mV。 CML波形： CML的输入一般都是片内匹配好的，50ohm上拉到VCC，而且大部分是交流耦合。 CML的输入结构： CML的摆幅一般在600mV-100mV之间，典型值为800mV。 CML逻辑参数： CML的优点是功耗低，速度高，但是驱动能力不如LVPECL，传输距离也没有ECL远。 LVPECL/LVDS/CML三种逻辑比较：
