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1、1,第5章存储器系统5.1内部存储器主要分为哪两类?它们的主要区别是什么?解:（1）分为ROM 和 RAM。（2）它们之间的主要区别是：。ROM在正常工作时只能读出，不能写入。RAM则可读可写。断电后，ROM中的内容不会丢失，RAM中的内容会丢失。5.2为什么动态RAM需要定时刷新？解：DRAM的存储元以电容来存储信息，由于存在漏电现象，电容中存储的电荷会逐渐泄漏，从而使信息丢失或出现错误。因此需要对这些电容定时进行“刷新”。5.3CPU寻址内存的能力最基本的因素取决于_。解：地址总线的宽度。5.4试利用全地址译码将6264芯片接到8088系统总线上，使其所占地址范围为32000H33FFFH
2、。解：将地址范围展开成二进制形式如下图所示。0011 0010 0000 0000 00000011 0011 1111 1111 11116264芯片的容量为88KB，需要13根地址线A0A12。而剩下的高7位地址应参加该芯片的地址译码。电路如图所示：,2,3,5.5内存地址从20000H8BFFFH共有多少字节？解：共有8BFFFH20000H16C000H个字节。或432KB。5.6若采用6264芯片构成上述的内存空间，需要多少片6264芯片？解：每个6264芯片的容量位8KB，故需432/854片。5.7设某微型机的内存RAM区的容量位128KB，若用2164芯片构成这样的存储器，需多
3、少2164芯片？至少需多少根地址线？其中多少根用于片内寻址？多少根用于片选译码？解：（1）每个2164芯片的容量为64K1bit，共需128/64816片。（2）128KB容量需要地址线17根。（3）16根用于片内寻址。（4）1根用于片选译码。注意，用于片内寻址的16根地址线要通过二选一多路器连到2164芯片，因为2164芯片是DRAM，高位地址与低位地址是分时传送的。5.8现有两片6116芯片，所占地址范围为61000H61FFFH，试将它们连接到8088系统中。并编写测试程序，向所有单元输入一个数据，然后再读出与之比较，若出错则显示“Wrong！“，全部正确则显示”OK！“。解：连接如下图
4、所示。测试程序段如下：OKDBOK!,$WRONGDBWrong!,$MOVAX,6100HMOVES,AX,4,MOVDI,0MOV CX,1000HMOVAL,55HREPSTOSBMOVDI,0MOVCX,1000HREPZSCASBJZDISP_OKLEADX,WRONGMOVAH,9INT21HHLTDISP_OK:LEADX,OKMOVAH,9INT21HHLT,5,6,5.9甚什么是字扩展？什么是位扩展？用户自己购买内存条进行内存扩充，是在进行何种存储器扩展？解：（1）当存储芯片的容量小于所需内存容量时，需要用多个芯片构成满足容量要求的存储器，这就是字扩展。（2）当存储芯片每个单
5、元的字长小于所需内存单元字长时，需要用多个芯片构成满足字长要求的存储模块，这就是位扩展。（3）用户在市场上购买内存条进行内存扩充，所做的是字扩展的工作。5.10 74LS138译码器的接线图如教材第245页的图5-47所示，试判断其输出端Y0#、Y3#、Y5#和Y7所决定的内存地址范围。解：因为是部分地址译码（A17不参加译码），故每个译码输出对应2个地址范围：Y0：00000H 01FFFH 和 20000H 21FFFHY3：06000H 07FFFH 和 26000H 27FFFHY5：0A000H 0BFFFH 和 2A000H 2BFFFHY7：0E000H 0FFFFH 和 2E0
6、00H 2FFFFH5.11某8088系统用2764 ROM芯片和6264 SRAM芯片构成16KB的内存。其中，ROM的地址范围为0FE000H0FFFFFH，RAM的地址范围为0F0000H0F1FFFH。试利用74LS138译码，画出存储器与CPU的连接图，并标出总线信号名称。解：连接如下图所示。,7,8,5.12 叙述EPROM的编程过程，并说明EPROM和EEPROM的不同点。（不要求）解：（1）对EPROM芯片的编程过程详见教材第215217页。（2）EPROM与EEPROM的不同之处为：。EPROM用紫外线擦除，EEPROM用电擦除。EPROM是整片擦除，EEPROM可以整片擦除
7、，也可以逐个字节地擦除。5.13 试说明FLASH EEPROM芯片的特点及28F040的编程过程。（不要求）解：（1）特点是：它结合了RAM和ROM的优点，读写速度接近于RAM，断电后信息又不会丢失。（2）28F040的编程过程详见教材第222223页。5.14 什么是Cache？它能够极大地提高计算机的处理能力是基于什么原理？解：（1）Cache 是位于CPU与主存之间的高速小容量存储器。（2）它能够极大地提高计算机的处理能力，是基于程序和数据访问的局部性原理。5.15 若主存DRAM的的存取周期为70ns，Cache的存取周期为5ns，有它们构成的存储器的平均存取周期是多少？解：平均存取周期约为 700.1ns+50.9ns=11.5ns。,
